FPC打样工厂

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为什么要导入类载板

极细化线路叠加SIP封装需求,高密度仍是主线智能手机、平板电脑和可穿戴设备等电子产品向小型化和多功能化方向发展,要搭载的元器件数量**增多然而留给线路板的空间却越来越有限。在这样的背景下,PCB导线宽度、间距,微孔盘的直径和孔中心距离,以及导体层和绝缘层的厚度都在不断下降,从而使PCB得以在尺寸、重量和体积减轻的情况下,反而能容纳更多的元器件。

极细化线路要求比HDI更高的制程。高密度促使PCB不断细化线路,锡球(BGA)间距不断缩短。在几年前,0.6mm-0.8mm节距技术已用在了当时的手持设备上,这一代智能手机,由于元件I/O数量和产品小型化,PCB***使用了0.4mm节距技术。而这一趋势正向0.3mm发展,事实上业内对用于移动终端的0.3mm间距技术的开发工作早已开始。同时,微孔大小和连接盘直径已分别下降到75mm和200mm。行业的目标是在未来几年内将微孔和盘分别下降到50mm和150mm。0.3mm的间距设计规范要求线宽线距30/30µm,现行的HDI不符合要求,需要更高制程的类载板。类载板更契合SIP封装技术要求。

RF PCB的十条标准 之六

6.对于那些在PCB上实现那些在ADS、 HFSS等仿真工具里面仿真生成的RF微带电路,尤其是那些定向耦合器、滤波器(PA的窄带滤波器)、微带谐振腔(比如你在设计VCO)、阻抗匹配网络等 等,则一定要好好的与PCB厂沟通,使用厚度、介电常数等指标严格和仿真时所使用的指标一致的板材。比较好的解决办法是自己找微波PCB板材的代理商购买对 应的板材,然后委托PCB厂加工。

7.在RF电路中,我们往往会用到晶体振荡器作 为频标,这种晶振可能是TCXO、OCXO或者普通的晶振。对于这样的晶振电路一定要远离数字部分,而且使用专门的低噪音供电系统。而更重要的是晶振可能 随着环境温度的变化产生频率飘移,对于TCXO和OCXO而言,仍然会出现这样的情况,只是程度小了一些而已。尤其是那些贴片的小封装的晶振产品,对环境 温度非常敏感。对于这样的情况,我们可以在晶振电路上加金属盖(不要和晶振的封装直接接触),来降低环境温度的突然变化导致晶振的频率的漂移。当然这样会 导致体积和成本上的提升.

在高速PCB设计时,设计者应该从那些方面去考虑EMC、EMI的规则呢?



一般EMI/EMC设计时需要同时考虑辐射(radiated)与传导(conducted)两个方面。前者归属于频率较高的部分(>30MHz)后者则是较低频的部分(<30MHz)。所以不能只注意高频而忽略低频的部分。

一个好的EMI/EMC设计必须一开始布局时就要考虑到器件的位置,PCB叠层的安排,重要联机的走法,器件的选择等,如果这些没有事前有较佳的安排,事后解决则会事倍功半,增加成本。

例如时钟产生器的位置尽量不要靠近对外的连接器,高速信号尽量走内层并注意特性阻抗匹配与参考层的连续以减少反射,器件所推的信号之斜率(slewrate)尽量小以减低高频成分,选择去耦合(decoupling/bypass)电容时注意其频率响应是否符合需求以降低电源层噪声。

另外,注意高频信号电流之回流路径使其回路面积尽量小(也就是回路阻抗loopimpedance尽量小)以减少辐射。还可以用分割地层的方式以控制高频噪声的范围。

适当的选择PCB与外壳的接地点(chassisground)。

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